Analog RD對layout的了解程度 - 工程師

By Dorothy
at 2014-03-07T23:29

Table of Contents

小弟入行四年大都待在小design house

最近公司schedule壓的很緊弄layout整合的又很菜

就被叫去一起幫看 whole-chip LVS

雖然以前LAB有學過design flow 不過對於解LVS還是不在行

但layout主管對於做design的不會解LVS 覺得不可思議

雖說有些公司RD也是要自己畫layout

不過對於analog RD來說到底是必備的嗎?

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Tags: 工程師

All Comments

By Frederica
at 2014-03-11T01:29

這個不會真的會被人家質疑你analog在做什麼的....

By Selena
at 2014-03-12T05:28

不是也是會有專職的layout人員

By George
at 2014-03-15T13:05

很多類比RD下對策而已

By Harry
at 2014-03-16T18:00

但有bug你不會看 layout人員更無解

By Ula
at 2014-03-19T14:22

解lvs 跟會layout本質上不一樣八..除非你說的layout
指的是開laker畫的話..是沒錯啦

By Zenobia
at 2014-03-23T19:51

老實說這東西很吃tool跟經驗

By Blanche
at 2014-03-28T05:36

小弟指的會layout是可以自己畫自己debug

By Necoo
at 2014-03-30T02:18

解lvs不是去看指令?這需要designer自己解?不是巴?!

By Lucy
at 2014-03-31T00:15

雖然說如果熟CAD tool的lvs語法可以幫忙但要RD跳下去也太..

By Wallis
at 2014-04-02T22:07

他說whole chip 也就是說把個別lay的合起來時會有lvs err?

By Adele
at 2014-04-07T21:21

個別的都pass。全部連完有error 好像還有很多線short

By Blanche
at 2014-04-08T01:37

還有甚麼好說的作integration那個太廢文章都講惹菜鳥

By Christine
at 2014-04-11T19:06

叫他一條一條自己去查阿馬的 designer地位很高的

By Adele
at 2014-04-15T22:06

designer地位很高?? 只能說工作多年看下來，職位沒什麼

By Caitlin
at 2014-04-16T17:29

尊卑，沒後端support靠designer能幹嘛?大家都是小螺絲

By Hazel
at 2014-04-18T01:17

其實要看老板但多半的design house 很挺Designer

By Elizabeth
at 2014-04-18T15:48

各部門都要優先支援RD

By Edward Lewis
at 2014-04-20T14:28

designer地位如何是靠你的專業和能力累積出來的，而不

By Joseph
at 2014-04-21T03:45

是自我膨脹自認為高人一等。這樣遲早被後端的人修理

By Sarah
at 2014-04-21T16:12

術業有專攻，先進製程layout,有多少designer能自己做?

By Ursula
at 2014-04-22T04:33

layout人員要解掉LVS error吧，有經驗的會跟你說是layout
有問題還是schematic有錯誤

By Callum
at 2014-04-24T07:49

現在EDA tool都蠻聰明的，LVS error方向抓不出是誇張點
但夠專業的analog RD應該可以看出端倪提供線索

By Una
at 2014-04-27T18:57

每一代tool版本不一樣吧　即便當學生換了一個版本就要適應
突然出問題要找完全是吃經驗　跟程度半點關係都沒有

By Hedy
at 2014-05-01T12:33

難道你要expect那些國際大咖教授知道
出現0個錯很可能表示你把VDD跟GND連在一起了...

By Yuri
at 2014-05-04T08:24

analog RD去抓whole chip lvs error? 真的頗ㄏ
都入行四年惹該有的價值能力擺在正確位置才對

By Jacky
at 2014-05-09T04:18

沒有甚麼自我膨脹高人一等喇先進製程layout也就比較複雜
是說whole chip layout又不是叫你去搞那種dummy還pitch rule

By Genevieve
at 2014-05-11T10:13

林盃layout engineer看多惹喇專業? 顆顆

By Megan
at 2014-05-13T11:10

哀都出來混那摸多年惹上網又何必假掰呢ㄎㄎ

By Andy
at 2014-05-15T21:22

既然術業有專攻,layout解自己工作上的問題不是應該的嗎?

By Zenobia
at 2014-05-16T00:57

而不是要找人來幫忙,別人幫不了又反過來質疑別人不行
說到底這是誰的責任誰的業務範圍?

By Kristin
at 2014-05-18T03:27

whole chip lvs能出問題的點太多了，叫cad team 的人一起
看比較實在

By Ophelia
at 2014-05-20T20:22

就遇過sram的spice 出現scale, std cell沒有，單位對不起
來，結果report檔幾百mb,還顯示一堆connection error,這你

By Jacky
at 2014-05-23T18:49

從頭一條一條看，看一年也看不出來，如果各block單獨驗都沒
問題，叫cad的人幫忙看會比較快，這不是layout出錯的機會
很大

By Ethan
at 2014-05-27T22:53

查lvs就用hcell的方式檢查,之後一層層往上檢查

By Joe
at 2014-05-28T10:19

我們公司的design都沒給過正確的SPI,每次我都自己改給他們

By Sarah
at 2014-05-29T13:13

小弟在敝司待六年還沒被layout叫去解LVS過

By Puput
at 2014-06-02T13:25

LVS當然是畫的那個人解呀誰知道你在鬼畫符什麼

By Carol
at 2014-06-04T05:56

Sub block就算了 whole chip就頗ㄏ

By Hamiltion
at 2014-06-07T14:23

看一下可以,叫designer解就太過份,誰知道你鬼畫符是畫啥

By Mason
at 2014-06-10T15:18

RD一定看得懂layout在畫什麼，有些較敏感訊號要特別處理

By Steve
at 2014-06-14T07:03

比較常遇到spice寫錯或layout device畫錯

By Hazel
at 2014-06-18T01:32

是我會很開心可以多學東西，RD多懂東西總是好的

By Rosalind
at 2014-06-22T16:24

哪一家類比RD..需要自己畫layout..說來聽聽..Orz

By Hardy
at 2014-06-25T21:18

<---自己排layout的RD ... 還要幫忙看 DRC/LVS @@

By Frederica
at 2014-06-26T00:18

其實強的Analog RD是都要會的，你是台清交畢業的學生嗎？

By Jake
at 2014-06-30T01:51

先看lvs error~是線路不對還是device對不到

By Catherine
at 2014-07-02T11:36

我覺得 layout 沒辦法找到 lvs 的錯誤這一點本身有點誇
張

資歷與薪水可談多少呢?

By Hardy
at 2014-03-07T23:10

各位好, 小弟最近在找工作這應該算是小弟正式出社會後找的第二份工作第一間公司的薪水是由對方開而這次找第二份工作時, 遇到些公司要求填寫 ...

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