工程師福利

Verification與DFT的選擇 - 工程師

Rosalind avatarRosalind · 2015-03-05

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各位大大們好，

小弟是碩畢新鮮人剛找工作

有幸錄取兩家ic design house

福利與待遇都差不多

但是職位不太一樣

一個是DFT工程師(design for testability)

一個是 verification驗證工程師

想請問各位大大如果只單看職位的話那個未來會比較有發展性呢？
謝謝！

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工程師福利

All Comments

Agatha avatarAgatha2015-03-10
verification若是寫system verilog 可以學學看
Carolina Franco avatarCarolina Franco2015-03-15
DFT 沒啥特別的 有時候就是整合的人負責 很少會有人
Genevieve avatarGenevieve2015-03-18
只負責DFT而已 也許未來可能要你去機台測試FT CP
Agatha avatarAgatha2015-03-20
若是如此 就看你自己 我不愛做DFT 我寧願學學SV
以後轉design會很有幫助
Hamiltion avatarHamiltion2015-03-25
Dft
Genevieve avatarGenevieve2015-03-25
NVIDIA嗎?
Harry avatarHarry2015-03-28
DFT + 1
Steve avatarSteve2015-03-30
發展性跟興趣有關，沒興趣，怎麼做都是渣渣..
Isla avatarIsla2015-04-02
verification
Freda avatarFreda2015-04-04
看興趣,DV有機會往前段跑,DFT有機會往後段跑,沒有一定哪
Harry avatarHarry2015-04-07
個發展一定比較好,DV工作機會多, DFT獨特性高...
Ida avatarIda2015-04-09
design一定比較高級的想法已經過時了,yield/dppm/coverage
隨便哪一個出問題都會讓一個產品失敗....
Sarah avatarSarah2015-04-13
DFT也是design喔 不是只有real function 才是design
Ophelia avatarOphelia2015-04-13
如果是CPU的verification會學到超多東西 包山包海
Kristin avatarKristin2015-04-18
從verification開始 以後接觸project的核心機會比較大
Belly avatarBelly2015-04-23
DFT則是高級版的synthesis, 對project了解有限, 但學起來
Damian avatarDamian2015-04-24
不管哪種PROJECT都適用, 性質跟backendAPR就很像
Eden avatarEden2015-04-25
觀念還是在於你對scan chain本身的定義有多少
Andrew avatarAndrew2015-04-26
做DFT好處是TOOL使用上, 有機會跟後段接軌, 只要加強一些
Kama avatarKama2015-04-29
physical跟STA的觀念 就可以往APR前進
Dora avatarDora2015-05-01
DFT需要下屬scan chain的timing constraints, 所以往前
Genevieve avatarGenevieve2015-05-03
做也是沒有問題的,建議先了解DFT在整個ASIC FLOW幹什麼的
Hedda avatarHedda2015-05-05
說說看 verification 用 verilog 驗, DUT 是甚麼 ?