南加 RFIC 面試分享 - offer
By Dorothy
at 2012-12-12T03:54
at 2012-12-12T03:54
Table of Contents
潛水兩三年, 終於可以回饋一點資訊
希望這對於想找 analog/RFIC 相關工作的板友會有些幫助
--------------------------------------------------
面試公司: 南加州某通信 IC 廠
面試職位: RFIC Designer
==== 背景 ====
我在美國出生所以是公民, 幼稚園到大學都在台灣
跑回美東念 EE PhD, 學校總排名還可以但做 RFIC 的人很少
我主攻 RF/mm-Wave power amplifier (PA)
除了當兵以外有三個工作經驗, 都是 intern:
- 聯發科 (做IC back-end design, 基本上是打雜)
- PhD 老闆開的 start-up (幫忙跑 inductor EM simulation)
- Intel (這是資格考考完之後去的, 做了半年多, 做的東西有 publish)
==== 求職方法 ====
今年初系上教授 forward 了一封該公司主管要人的 email
當時我離畢業還有很多問號, 但想想不會有損失就把履歷寄過去了
過幾天就收到 HR 寄信說已經安排了兩個電話面試
==== 電話面試 ====
兩通電話面試都很類似, 過程都差不多一小時
雙方簡單自我介紹之後二話不說就是 technical questions
題目包括 RFIC 各 block 基本題搭配些應用題, 例如:
- 給 VDD 和 output power, 設計一個 class A PA, 計算效率等參數
- Common source configuration 在 source 端接個電感
算輸入阻抗, 解釋這對 LNA 有何幫助
- 如何計算 CMOS 電路的 noise
- 列出影響電感 Q factor 的各種因素
- 應用題: 拿 spectrum analyzer 想量 PA 的 noise floor
但 analyzer 的 dynamic range 不夠, 何解? (答: use bandpass filter)
好險前一晚把兩本 Razavi 都複習一遍, 有些問題是直接從課本裡出來的..
==== On-site 面試 ====
電話面試兩週後收到通知要 on-site 了
面試前一晚飛到該地拖著疲憊的腳步下榻旅館
想不到旅館櫃台端了出面試公司準備的 greeting card 和 cheese plate (yum)
有點小小感動!
第二天一早到 HR 棟報到, 拿了資料再坐 shuttle 到了園區其中一棟高樓
第一關是一小時的投影片簡報, 主要講我 PhD 在做的東西
來了六個人很仔細在聽 (後來發現其中有兩個其實不是面試官)
簡報完之後, 接著就是一連七個小時七關面試
其中午餐的面試都在聊天 (無 technical Q&A)
HR那關也只是聽他在解釋 offer package/benefits
其他的面試都極度 technical
我還記得的題目包括:
- 畫一個典型 TX chain block diagram
- 如果 LO 有 I/Q mismatch, 對 double-balanced mixer 有何影響
- 如果為了降低輸出功率而 size down driver amp, 對 SNR 有何影響
- 畫一個 bandgap reference 電路
- 如何產生 PTAT reference
- what about CTAT?
- 畫一個 folded cascode amp
- 求 gain/dominant pole/unity gain BW
- noise 主要從何而來?
(這面試官是我同實驗室學長, 所以上面兩題算送分題 XD)
- 電路模擬應用題: 給一個 2-port s-parameter block
- 如何模擬 diff.-mode 和 common-mode responses?
- 如何模擬電路 stability? (小信號/大信號)
- 面試官在白板上畫了一個 LNA + input match
- 如何修改 input match 來降低 common-mode leakage
- 白板上又畫了一個 cascode PA w/ output match (L-match w/ shunt capacitor)
- 如何修改 output match 來降低 2nd harmonic
(這兩題都不只一種答案, 但考官心理的答案是很 clever 的加一個 element 就可解)
- 解釋如何用 Smith chart 設計 matching network
- 如何把 50 Ohm match 到 5 Ohm
- 如何改善頻寬
- 改善頻寬若用兩組 L-match, 怎麼選中間的阻抗
最後一關進主管辦公室 (果然兩面都有窗戶..)
先是針對一開始的報告問了些問題
介紹了一下整個 group 概況
接著也問了些技術性問題, 不過跟前面問過的有些重複就不贅述了~
當然, 幾乎所有面試官都問我自己有無問題想問
我在行前也準備了一些問題:
- 公司的 RFIC designer 做的事情和學校裡有何異同 (答案是差不多, 但苦工較少)
- 公司對風險高的設計有何策略, 趕工之餘是否會嘗試 new idea
- 對於研發成果發 paper/發專利兩種選擇有何看法
- 公司如何評估員工 performance, 員工之間如何 team-up
- 公司是否有把 PA 整合到 SoC 的計畫 (答案: 無可奉告 XD)
==== 後續 ====
面試後兩周收到 HR 回覆說:
面試官反應正面, 但目前尚無法承諾 offer, 請年底再連絡
(因為面試時為今年三月, 當時我跟他們說至少要一年才會畢業)
中間大概在七月和九月又被 HR 連絡上, 問畢業進度
終於在十一月跟他們卻定了最早到職日, 才發了 offer
==== 建議 ====
- 不管當初修課分數多高, 久了一定會忘掉一些
把面試當做準備期末考, 課本全部拿出來翻過, 做些題目, 絕對有幫助
- 電話面試請把課本或筆記隨手放旁邊, 很管用
- 面試過程中緊張是一定會的, 但是在不會不自然的情況下, 保持微笑吧
題目不會就坦承這個子領域不熟, 然後依自己能力給個定性的描述或分析
不見得會是扣分
- 行前多準備些自己要問的問題, 多打聽些公司相關的情報
因為有的面試官不會馬上切入技術問題, 有其他話題聊也有幫助
至少可以縮短技術問題煎熬的時間 XD
- 記得帶個水壺... 萬一對方沒幫你準備礦泉水, 講不到幾個小時嘴就乾了
最後祝大家求職面試順利!
--
希望這對於想找 analog/RFIC 相關工作的板友會有些幫助
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面試公司: 南加州某通信 IC 廠
面試職位: RFIC Designer
==== 背景 ====
我在美國出生所以是公民, 幼稚園到大學都在台灣
跑回美東念 EE PhD, 學校總排名還可以但做 RFIC 的人很少
我主攻 RF/mm-Wave power amplifier (PA)
除了當兵以外有三個工作經驗, 都是 intern:
- 聯發科 (做IC back-end design, 基本上是打雜)
- PhD 老闆開的 start-up (幫忙跑 inductor EM simulation)
- Intel (這是資格考考完之後去的, 做了半年多, 做的東西有 publish)
==== 求職方法 ====
今年初系上教授 forward 了一封該公司主管要人的 email
當時我離畢業還有很多問號, 但想想不會有損失就把履歷寄過去了
過幾天就收到 HR 寄信說已經安排了兩個電話面試
==== 電話面試 ====
兩通電話面試都很類似, 過程都差不多一小時
雙方簡單自我介紹之後二話不說就是 technical questions
題目包括 RFIC 各 block 基本題搭配些應用題, 例如:
- 給 VDD 和 output power, 設計一個 class A PA, 計算效率等參數
- Common source configuration 在 source 端接個電感
算輸入阻抗, 解釋這對 LNA 有何幫助
- 如何計算 CMOS 電路的 noise
- 列出影響電感 Q factor 的各種因素
- 應用題: 拿 spectrum analyzer 想量 PA 的 noise floor
但 analyzer 的 dynamic range 不夠, 何解? (答: use bandpass filter)
好險前一晚把兩本 Razavi 都複習一遍, 有些問題是直接從課本裡出來的..
==== On-site 面試 ====
電話面試兩週後收到通知要 on-site 了
面試前一晚飛到該地拖著疲憊的腳步下榻旅館
想不到旅館櫃台端了出面試公司準備的 greeting card 和 cheese plate (yum)
有點小小感動!
第二天一早到 HR 棟報到, 拿了資料再坐 shuttle 到了園區其中一棟高樓
第一關是一小時的投影片簡報, 主要講我 PhD 在做的東西
來了六個人很仔細在聽 (後來發現其中有兩個其實不是面試官)
簡報完之後, 接著就是一連七個小時七關面試
其中午餐的面試都在聊天 (無 technical Q&A)
HR那關也只是聽他在解釋 offer package/benefits
其他的面試都極度 technical
我還記得的題目包括:
- 畫一個典型 TX chain block diagram
- 如果 LO 有 I/Q mismatch, 對 double-balanced mixer 有何影響
- 如果為了降低輸出功率而 size down driver amp, 對 SNR 有何影響
- 畫一個 bandgap reference 電路
- 如何產生 PTAT reference
- what about CTAT?
- 畫一個 folded cascode amp
- 求 gain/dominant pole/unity gain BW
- noise 主要從何而來?
(這面試官是我同實驗室學長, 所以上面兩題算送分題 XD)
- 電路模擬應用題: 給一個 2-port s-parameter block
- 如何模擬 diff.-mode 和 common-mode responses?
- 如何模擬電路 stability? (小信號/大信號)
- 面試官在白板上畫了一個 LNA + input match
- 如何修改 input match 來降低 common-mode leakage
- 白板上又畫了一個 cascode PA w/ output match (L-match w/ shunt capacitor)
- 如何修改 output match 來降低 2nd harmonic
(這兩題都不只一種答案, 但考官心理的答案是很 clever 的加一個 element 就可解)
- 解釋如何用 Smith chart 設計 matching network
- 如何把 50 Ohm match 到 5 Ohm
- 如何改善頻寬
- 改善頻寬若用兩組 L-match, 怎麼選中間的阻抗
最後一關進主管辦公室 (果然兩面都有窗戶..)
先是針對一開始的報告問了些問題
介紹了一下整個 group 概況
接著也問了些技術性問題, 不過跟前面問過的有些重複就不贅述了~
當然, 幾乎所有面試官都問我自己有無問題想問
我在行前也準備了一些問題:
- 公司的 RFIC designer 做的事情和學校裡有何異同 (答案是差不多, 但苦工較少)
- 公司對風險高的設計有何策略, 趕工之餘是否會嘗試 new idea
- 對於研發成果發 paper/發專利兩種選擇有何看法
- 公司如何評估員工 performance, 員工之間如何 team-up
- 公司是否有把 PA 整合到 SoC 的計畫 (答案: 無可奉告 XD)
==== 後續 ====
面試後兩周收到 HR 回覆說:
面試官反應正面, 但目前尚無法承諾 offer, 請年底再連絡
(因為面試時為今年三月, 當時我跟他們說至少要一年才會畢業)
中間大概在七月和九月又被 HR 連絡上, 問畢業進度
終於在十一月跟他們卻定了最早到職日, 才發了 offer
==== 建議 ====
- 不管當初修課分數多高, 久了一定會忘掉一些
把面試當做準備期末考, 課本全部拿出來翻過, 做些題目, 絕對有幫助
- 電話面試請把課本或筆記隨手放旁邊, 很管用
- 面試過程中緊張是一定會的, 但是在不會不自然的情況下, 保持微笑吧
題目不會就坦承這個子領域不熟, 然後依自己能力給個定性的描述或分析
不見得會是扣分
- 行前多準備些自己要問的問題, 多打聽些公司相關的情報
因為有的面試官不會馬上切入技術問題, 有其他話題聊也有幫助
至少可以縮短技術問題煎熬的時間 XD
- 記得帶個水壺... 萬一對方沒幫你準備礦泉水, 講不到幾個小時嘴就乾了
最後祝大家求職面試順利!
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By James
at 2012-12-15T11:12
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By Kristin
at 2012-12-17T21:26
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at 2012-12-21T23:14
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By Christine
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By Belly
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By Irma
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By Christine
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By Caroline
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at 2012-12-11T22:24
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at 2012-12-11T07:32
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By Irma
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By Victoria
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