強的主管長怎樣? - 工程師
By Steve
at 2012-12-30T15:52
at 2012-12-30T15:52
Table of Contents
※ 引述《rosemary0401 (rosemary)》之銘言:
: 板上提到主管幾乎都是負面的:嘴砲、短視近利、豬頭、沒擔當、搶功勞、推責任、養親
: 信、無能...
: 很好奇大家看過強的主管長怎樣??有哪些特質??
: 我主管的工作大都是寫mail、開會、面試、分派工作...等等。
: 開會時就說"我們目前解了哪些Bugs,哪些Bugs還沒解,遇到哪些問題...等等",不過就
: 是把Bug track system上的東西整理一下,拿出來照著講一遍而已。坦白說真的不知道
: 我主管他強在哪裡。
: 在我們公司課長、主任級的小主管都還要寫程式,到副理以上的就不需要寫程式了。私底
: 下跟一些工程師討論,大家普遍還是覺得專業能力強的主管比較強,但是一般來說,主管
: 的專業能力普遍輸給資深工程師,畢竟主管不像工程師一樣整天在專業技術方面下功夫。
: 如果撇開主管的專業技術不談,一個主管在專業以外的工作就是寫mail、開會、面試、分
: 派工作...,而主管做的這些專業以外的事真的有那麼難嗎???
: 之前有一些新聞是謊稱擁有外國高學歷以騙取主管一職,而被騙的公司難道沒辦法在面試
: 時揭穿這些騙徒到底有沒有料嗎??這樣的事我想應該很難發生在工程師上,畢竟專業的東
: 西,有沒有料稍微問一下、考一下便知。我在想所謂的管理能力是不是難以鑑別,以至
: 於在面試的時候很難去分辨一個人到底是真的有管理能力還是只是嘴砲。
以下是我朋友說的
有遇過一個蠻強的主管
它會讓你只要專注在你自身的工作
不需要開額外的會議
一些需要跨部門的會議
像是決定spec、layer選擇、test chip整合
這種基本上都不會跑到你身上
你只要把你負責的電路做完就可以
整合部分會讓做APR的人負責
基本上你要開的會只有以下
a.design review
b.week meeting
c.APR layout review
要負責的工作只有以下
a.design circuit
b.量測CTS
只要有不是以上的東西找你,他會幫你擋下來
有電路不懂的,他會教你,會的電路多到很誇張
有人離職,他會直接扛下來自己做一次後再交接給別人
但是強的主管也是有機車的地方
a.上面的meeting你沒有充分準備好,有電路講錯會被釘在上面下不來
,你設計的電路完成後的報告開會通常都是3小時
b.會請你自己講一個design時間,如果不是他預想的,就會請你再想想看
,直到是他認為合理的schedule,定的電路deadline都很急迫
,他很清楚full time在電路上需要多久時間
,但是如果遇到chip回來要量測,基本上他不希望量測影響設計電路的時間
,所以design與量測常常中間交錯一直循環
,至於做不完的請自己想辦法,頂多讓你延一個禮拜
,所以通常在deadline到的前一兩個禮拜,假日都會自己跑來加班
c.他認為layout是layout的事情,不是讓你layout就沒事
,所以當你design完進layout後
,會希望你中間再做一個簡單的PLL
這種主管您覺得好嗎
好處是你會在短時間內下過很多次chip(一年下6~7次電路)
壞處是可能沒時間去思考一些可以做得更好的電路
--
偶成 宋‧朱熹
少年易老學難成,一寸光陰不可輕;
未覺池塘春草夢,階前梧葉已秋聲
--
: 板上提到主管幾乎都是負面的:嘴砲、短視近利、豬頭、沒擔當、搶功勞、推責任、養親
: 信、無能...
: 很好奇大家看過強的主管長怎樣??有哪些特質??
: 我主管的工作大都是寫mail、開會、面試、分派工作...等等。
: 開會時就說"我們目前解了哪些Bugs,哪些Bugs還沒解,遇到哪些問題...等等",不過就
: 是把Bug track system上的東西整理一下,拿出來照著講一遍而已。坦白說真的不知道
: 我主管他強在哪裡。
: 在我們公司課長、主任級的小主管都還要寫程式,到副理以上的就不需要寫程式了。私底
: 下跟一些工程師討論,大家普遍還是覺得專業能力強的主管比較強,但是一般來說,主管
: 的專業能力普遍輸給資深工程師,畢竟主管不像工程師一樣整天在專業技術方面下功夫。
: 如果撇開主管的專業技術不談,一個主管在專業以外的工作就是寫mail、開會、面試、分
: 派工作...,而主管做的這些專業以外的事真的有那麼難嗎???
: 之前有一些新聞是謊稱擁有外國高學歷以騙取主管一職,而被騙的公司難道沒辦法在面試
: 時揭穿這些騙徒到底有沒有料嗎??這樣的事我想應該很難發生在工程師上,畢竟專業的東
: 西,有沒有料稍微問一下、考一下便知。我在想所謂的管理能力是不是難以鑑別,以至
: 於在面試的時候很難去分辨一個人到底是真的有管理能力還是只是嘴砲。
以下是我朋友說的
有遇過一個蠻強的主管
它會讓你只要專注在你自身的工作
不需要開額外的會議
一些需要跨部門的會議
像是決定spec、layer選擇、test chip整合
這種基本上都不會跑到你身上
你只要把你負責的電路做完就可以
整合部分會讓做APR的人負責
基本上你要開的會只有以下
a.design review
b.week meeting
c.APR layout review
要負責的工作只有以下
a.design circuit
b.量測CTS
只要有不是以上的東西找你,他會幫你擋下來
有電路不懂的,他會教你,會的電路多到很誇張
有人離職,他會直接扛下來自己做一次後再交接給別人
但是強的主管也是有機車的地方
a.上面的meeting你沒有充分準備好,有電路講錯會被釘在上面下不來
,你設計的電路完成後的報告開會通常都是3小時
b.會請你自己講一個design時間,如果不是他預想的,就會請你再想想看
,直到是他認為合理的schedule,定的電路deadline都很急迫
,他很清楚full time在電路上需要多久時間
,但是如果遇到chip回來要量測,基本上他不希望量測影響設計電路的時間
,所以design與量測常常中間交錯一直循環
,至於做不完的請自己想辦法,頂多讓你延一個禮拜
,所以通常在deadline到的前一兩個禮拜,假日都會自己跑來加班
c.他認為layout是layout的事情,不是讓你layout就沒事
,所以當你design完進layout後
,會希望你中間再做一個簡單的PLL
這種主管您覺得好嗎
好處是你會在短時間內下過很多次chip(一年下6~7次電路)
壞處是可能沒時間去思考一些可以做得更好的電路
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偶成 宋‧朱熹
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at 2012-12-30T23:40
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